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373为三态输出的八 D 透明锁存器,共有 54S373 和 74LS373 两种线路 结构型式,其主要电器特性的典型值如下(不同厂家具体值有差别): 型号 TPDPD 54S373/74S373 7ns 525mW 54LS373/74LS373 17ns 120mW 373 的输出端 O0~O7 可直接与总线相连。 当三态允许控制端 OE 为低电平时,Q0~Q7为正常逻辑状态,可用来驱动负载或总线。当 OE 为高电平时,Q0~Q7 呈高阻态,即不驱动总线,也不为总线的负载,但锁存器内部的逻辑操作不受影响。 当锁存允许端 LE 为高电平时,Q 随数据 D 而变。当 LE 为低电平时,D 被锁存在已建立的数据电平。当 LE 端施密特触发器的输入滞后作用,使交流和直流噪声抗扰度被改善 400mV。
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该芯片主要用于数据存储和移位寄存器,它具有透明存储能力,能够传输和保持数据在高或低状态。此外,它还可以在同步时刻,将存储的数据输出到指定的终端,实现数据在不同模块之间的传输。此外,74ls373芯片与其他芯片组合使用时,还可实现存储器的工作,具有广泛的应用。
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74ls373芯片是一种透明锁存器芯片,它的功能是存储和输出数据。它具有高速响应、广泛的输入电压范围和广泛的负载容量等特点。同时,它还可用于实现存储和移位等复杂的逻辑功能,所以在数字电路中得到了广泛的应用。
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74LS373是一种透明锁存器芯片,可以将8位数据锁存并输出。它有8个数据输入端和8个数据输出端,还有一个控制端。通过控制端的使能信号,可以控制数据输入是否被锁存,也可以控制输出是否有效。这种芯片适用于数字系统中需要存储和传输数据的场合,如存储器地址寄存器、数据总线驱动器等。
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74ls373是八D锁存器(三态). 一个封装中有八个锁存器,三态总线驱动输出,置数全并行存取,缓冲控制输入,时钟/使能输入有改善抗扰度的滞后作用.
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本文概览:373为三态输出的八 D 透明锁存器,共有 54S373 和 74LS373 两种线路 结构型式,其主要电器特性的典型值如下(不同厂家具体值有差别): 型号 TPDPD 54S373/74S373 7ns 525mW 54LS373/74LS373 17ns 120mW 373 的输出端 O0~O7 可直接与总线相连。 当三态允许控制端 OE 为低电平时,Q0~Q7为正常逻辑状态,可用来驱动负载或总线。当 OE 为高电平时,Q0~Q7 呈高阻态,即不驱动总线,也不为总线的负载,但锁存器内部的逻辑操作不受影